エが正解である理由は、NANDゲートの特性から導かれます。NANDゲートは、全ての入力が1のときのみ0を出力し、それ以外の場合は1を出力する論理ゲートです。問題文には図表があるとありますが、その図表に示されたNANDゲートの組合せ回路が、最終的にすべての入力A, B, C, Dが1である場合にのみ出力Xが0となる構成であると仮定すると、出力Xは「A, B, C, Dの論理積の否定」となります。論理式で表現すると X = ¬(A・B・C・D) となります。しかし、選択肢は論理積と論理和のみで構成されており、否定(¬)は含まれていません。これは、選択肢が回路の最終出力ではなく、途中の論理値である可能性、あるいは問題文の意図がNANDゲートの組み合わせによる「単純な論理積」を問うている可能性を示唆しています。もし、図表の回路が最終的にA, B, C, Dすべてが1のときにのみ出力が1となるような構成(例えば、NANDゲートの出力をさらに否定する構成)であれば、出力Xは A・B・C・D となります。選択肢にこの形式があることから、この解釈が最も整合性が高いと考えられます。
基本情報技術者2015年度 秋期午前問 23
2015年度 秋期 基本情報技術者 午前 問23
難度
標準
図の NAND ゲートの組合せ回路で、入力 A, B, C, Dに対する出力Xの論理式はどれか。ここで、論理式中の“・”は論理積,“+”は論理和を表す。
選択肢
ア(A+B)・(C+D)
イA+B+C+D
ウA・B+C.D
エA・B・C・D
解説
結論 → 詳細 → 補足 の 3 層構成
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解説
結論 → 詳細 → 補足 の 3 層構成
アは、(A+B)・(C+D)という論理式であり、これは入力A, Bの論理和とC, Dの論理和の論理積を表しており、A, B, C, Dのすべての入力が1である場合に必ずしも1になるとは限らないため、不正解です。イのA+B+C+Dは、いずれかの入力が1であれば1となる論理和であり、NANDゲートの組合せ回路の出力として、すべての入力が1のときに0になるという特性とは大きく異なります。ウのA・B+C.Dは、AとBの論理積、またはCとDの論理積という構成であり、これもA, B, C, Dすべての入力が1である場合にのみ特定の出力をするわけではないため、不適切です。
この解説は?
この解説は AI 生成です(詳細)
解説テキストは Google Gemini に IPA 公式の問題文・公式解答を入力して生成しました。 人間によるレビューを行ったものと、未レビューのものが混在します。
AI は事実誤認・選択肢の取り違え・最新法令の反映漏れ等を含む可能性があります。 重要な判断は必ず IPA 公式 PDF または最新の参考書でご確認ください。
解説の検証プロセス・誤り報告フローは 運営透明性レポートで公開しています。
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